| 流水线模拟数字转换器的权重误差校准 |
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| 引用本文： | 贾华宇,刘丽,张建国.流水线模拟数字转换器的权重误差校准[J].光学精密工程,2014,22(11):3114-3121. |
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| 作者姓名： | 贾华宇 刘丽 张建国 |
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| 作者单位： | 太原理工大学新型传感器与智能控制教育部重点实验室,山西太原,030024 |
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| 基金项目： | 国家自然科学基金项目资助，国家教育部博士点基金项目资助 |
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| 摘 要： | 为校准流水线模拟数字转换器(ADC)中电容失配和由运算放大器的有限开环增益引起的级间增益误差,提出了一种新的基于权重的后台校准技术。该技术将流水线ADC中存在的上述误差统一归结为各级权重的偏差,建立了一个基于权重的ADC误差模型,并利用后级的数字输出来校准前级的误差。该技术在ADC末尾增加了额外的两个子级,这两个子级仅在校准过程中使用,从而使得ADC正常的模数转换过程不被中断,校准进程在后台执行。由于在校准期间和正常工作期间所有可能出现的信号路径的前7级均被校准,故进一步减小了误差,提高了精度。应用该技术实现了一个14bit,80 MS/s的流水线ADC,该芯片采用Chartered 0.18μm,1p6mCMOS工艺设计,总功耗为260mW,芯片面积为7.161mm2。实验结果显示:本文提出的校准技术可以提高ADC的精度,改善ADC的动态和静态性能。
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| 关 键 词： | 流水线模拟数字转换器 级间增益误差 数字校准 后台校准 状态机 |
Calibration of weight-error for pipelined ADCs |
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| JIA Hua-yu
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LIU Li
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ZHANG Jian-guo.Calibration of weight-error for pipelined ADCs[J].Optics and Precision Engineering,2014,22(11):3114-3121. |
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| Authors: | JIA Hua-yu LIU Li ZHANG Jian-guo |
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| Abstract: | |
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| Keywords: | pipelined Analog-to-Digital Converter(ADC) interstage gain error digital calibration background calibration finite state machine(FSM) |
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