| 应用于DSRC系统的5.8GHz CMOS LNA设计 |
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| 引用本文： | 艾学松,孙玲,施佺.应用于DSRC系统的5.8GHz CMOS LNA设计[J].电路与系统学报,2012,17(3):134-138. |
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| 作者姓名： | 艾学松 孙玲 施佺 |
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| 作者单位： | 南通大学江苏省专用集成电路设计重点实验室,江苏南通,226019 |
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| 基金项目： | 江苏省高校自然科学研究重大项目，江苏省"青蓝工程"项目资助(2010年度) |
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| 摘 要： | 基于TSMC 0.18μm CMOS RF工艺,完成了一个全集成共源-共栅低噪声放大器设计。版图后仿真结果表明:1.8V电源电压下,电路静态功耗约为17mW;在DSRC系统工作频段上,电路实现了良好的综合性能指标,输入反射系数(S11)和输出反射系数(S22)小于-15dB,增益(S21)大于14.0dB,反向隔离度(S12)达到32dB,噪声系数小于2dB,并且工作稳定。
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| 关 键 词： | 低噪声放大器 噪声系数 交通专用短程通信 不停车收费 |
A design of 5.8 GHz CMOS LNA for DSRC application |
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| AI Xue-song
,
SUN Ling
,
SHI Quan.A design of 5.8 GHz CMOS LNA for DSRC application[J].Journal of Circuits and Systems,2012,17(3):134-138. |
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| Authors: | AI Xue-song SUN Ling SHI Quan |
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| Affiliation: | Quan(Jiangsu Key Laboratory of ASIC Design,Nantong University,Nantong 226019,China) |
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| Abstract: | Based on TSMC 0.18μm RF CMOS technology,a fully integrated cascade LNA is designed.In DSRC band,the circuit has perfect performance.The post-layout simulation results show that the input return loss(S11) and output return loss(S22) are lower than-15dB,the gain(S21) is greater than 14dB,the reverse isolation(?S12?) reaches 32dB and the NF is lower than 2dB.It dissipates about 17 mW at 1.8V supply voltage,and works with good stability. |
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| Keywords: | low noise amplifier noise figure DSRC ETC |
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