| 一种基于FPGA进位链的时间数字转换器 |
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| 引用本文： | 王巍,周浩,熊拼搏,李双巧,杨皓,杨正琳,袁军.一种基于FPGA进位链的时间数字转换器[J].微电子学,2016,46(6):777-780, 787. |
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| 作者姓名： | 王巍 周浩 熊拼搏 李双巧 杨皓 杨正琳 袁军 |
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| 作者单位： | 重庆邮电大学 光电工程学院/国际半导体学院, 重庆 400065,重庆邮电大学 光电工程学院/国际半导体学院, 重庆 400065,重庆邮电大学 光电工程学院/国际半导体学院, 重庆 400065,重庆邮电大学 光电工程学院/国际半导体学院, 重庆 400065,重庆邮电大学 光电工程学院/国际半导体学院, 重庆 400065,重庆邮电大学 光电工程学院/国际半导体学院, 重庆 400065,重庆邮电大学 光电工程学院/国际半导体学院, 重庆 400065 |
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| 基金项目： | 国家自然科学基金资助项目(61404019) |
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| 摘 要： | 提出了一种基于Xilinx Virtex-5 FPGA的时间数字转换器。利用Virtex-5中专用进位链CARRY4构造的延迟链,对时钟周期进行内插以得到更高精度的测量。此外,运用布局布线约束来减少延迟链的不一致性,降低了微分非线性(DNL)以及积分非线性(INL)。仿真结果表明,最低有效位(LSB)为52.22 ps,精度(RMS)约为25 ps,INL为0~0.9 LSB,DNL为－0.03~0.1 LSB。
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| 关 键 词： | 时间数字转换器 进位链 CARRY4 布局布线 可编程逻辑器件 |
A TDC Based on Carry-in Lines of the FPGA |
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| WANG Wei,ZHOU Hao,XIONG Pinbo,LI Shuangqiao,YANG Hao,YANG Zhenglin and YUAN Jun.A TDC Based on Carry-in Lines of the FPGA[J].Microelectronics,2016,46(6):777-780, 787. |
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| Authors: | WANG Wei ZHOU Hao XIONG Pinbo LI Shuangqiao YANG Hao YANG Zhenglin and YUAN Jun |
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| Affiliation: | College of Electronics Engineering/International Semiconductor College, Chongqing University of Posts and Telecommunications, Chongqing 400065, P. R. China,,College of Electronics Engineering/International Semiconductor College, Chongqing University of Posts and Telecommunications, Chongqing 400065, P. R. China,,College of Electronics Engineering/International Semiconductor College, Chongqing University of Posts and Telecommunications, Chongqing 400065, P. R. China,,College of Electronics Engineering/International Semiconductor College, Chongqing University of Posts and Telecommunications, Chongqing 400065, P. R. China,,College of Electronics Engineering/International Semiconductor College, Chongqing University of Posts and Telecommunications, Chongqing 400065, P. R. China,,College of Electronics Engineering/International Semiconductor College, Chongqing University of Posts and Telecommunications, Chongqing 400065, P. R. China, and College of Electronics Engineering/International Semiconductor College, Chongqing University of Posts and Telecommunications, Chongqing 400065, P. R. China, |
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| Abstract: | |
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| Keywords: | Time-to-digital converter (TDC) Carry-in line CARRY4 Place and route (PAR) FPGA |
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