| 用分量匹配法实现对高速时钟电路的动态优化 |
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| 引用本文： | 魏敬和,陈军宁,柯导明,时龙兴,陆生礼,樊进.用分量匹配法实现对高速时钟电路的动态优化[J].电子学报,2004,32(9):1569-1571. |
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| 作者姓名： | 魏敬和 陈军宁 柯导明 时龙兴 陆生礼 樊进 |
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| 作者单位： | 1. 安徽大学电子工程与信息科学系,安徽合肥 230039;2. 东南大学电子工程系,江苏南京 210096 |
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| 基金项目： | 国家自然科学基金，国家高技术研究发展计划(863计划)，安徽省自然科学基金 |
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| 摘 要： | 本文讨论如何设计工作在GHz频率下的VLSI芯片时钟电路.时钟树采用平衡平面布局消除时钟偏差;利用插入缓冲器对电路性能进行动态优化.最后用一个电路模拟软件对电路进行评估.和以往的工作相比较,本文实现了在频域内对时钟电路的优化,显著地提高了仿真速度.
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| 关 键 词： | 分量匹配法 时钟电路 传输线 |
| 文章编号： | 0372-2112(2004)09-1569-03 |
| 收稿时间： | 2003-06-06 |
Dynamical Optimizing High-Speed Clock Tree by Moment Matching Method |
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| WEI Jing-he,CHEN Jun-ning,KE Dao-ming,SHI Long-xing,LU Sheng-li,FANG Jin.Dynamical Optimizing High-Speed Clock Tree by Moment Matching Method[J].Acta Electronica Sinica,2004,32(9):1569-1571. |
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| Authors: | WEI Jing-he CHEN Jun-ning KE Dao-ming SHI Long-xing LU Sheng-li FANG Jin |
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| Affiliation: | 1. Dept.of electronic engineering & information science,Anhui University,Hefei,Anhui 230039,China;2. Dept.of electronic engineering,Southeast University,Nanjing,Jiangsu 210096,China |
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| Abstract: | We discuss the design of clock distribution circuits for VLSI chips operating at GHz frequency.Clock tree uses balanced planar tree routing to eliminate the clock skew;and dynamically optimize clock circuit by inserting buffers.Finally we evaluate the clock circuit performance by simulator.The method realizes the optimization of clock circuit in the frequent domain,and dramatically improve simulating time compared with previous work. |
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| Keywords: | moment matching method clock circuit transmission line |
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