| 变参数RS译码器IP核的实现 |
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| 引用本文： | 陈启亮,余宁梅,刘高辉.变参数RS译码器IP核的实现[J].固体电子学研究与进展,2005,25(3):357-360,415. |
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| 作者姓名： | 陈启亮 余宁梅 刘高辉 |
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| 作者单位： | 西安理工大学电子工程系,西安,710048;西安理工大学电子工程系,西安,710048;西安理工大学电子工程系,西安,710048 |
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| 基金项目： | 日本0KI公司资助研究的国际合作项目 |
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| 摘 要： | 设计出一种码长可以变化的RS码译码器IP核电路,可进行RS(15,5)、RS(15,7)、RS(15,9)以及RS(15,11)的译码。译码器电路使用BM迭代译码算法,并在硬件电路中加以改进,使得电路能扩充到编译纠错位数多的复杂RS码。该译码器电路尽可能多地使用可以共享的模块,降低了电路的规模。硬件电路采用V erilogHDL进行描述,并在FPGA上进行了验证,同时给出了硬件电路在逻辑分析仪上得到的结果。
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| 关 键 词： | RS译码器 IP核 BM迭代算法 |
| 文章编号： | 1000-3819（2005）03-0357-04 |
| 收稿时间： | 2004-11-12 |
| 修稿时间： | 2004-11-122004-12-23 |
IP Core Design for Varied Parameters RS Decoder |
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| CHEN Qiliang,YU Ningmei,LIU Gaohui.IP Core Design for Varied Parameters RS Decoder[J].Research & Progress of Solid State Electronics,2005,25(3):357-360,415. |
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| Authors: | CHEN Qiliang YU Ningmei LIU Gaohui |
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| Abstract: | |
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| Keywords: | RS decoder IP core BM iterative algorithm |
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