常系数FIR中的CSD串并乘法器设计 |
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引用本文: | 宋秀兰,李晓江. 常系数FIR中的CSD串并乘法器设计[J]. 电子器件, 2009, 32(4): 797-800 |
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作者姓名: | 宋秀兰 李晓江 |
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作者单位: | 浙江工业大学信息工程学院,杭州,310014;中国科学院微电子研究所,北京,100029 |
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摘 要: | 介绍了二进制数的Canonic Signed Digit(CSD)表示的特点,0位值比其他表示方法都要多.应用这一点在常系数的乘法器中,可以化简电路.阐述了CSD串并乘法器的具体化简过程,并应用这一技术于IS95-WCDMA中的脉冲整形23阶常系数FIR的设计中,面积缩小达42%.结果表明:CSD的化简效果是明显的.
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关 键 词: | 数字信号处理 标准符号数位码 串并乘法器 常系数FIR |
Design CSD Serial-Parallel Multiplier for constant coefficients FIR filter |
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Abstract: | |
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Keywords: | |
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