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14位100MSPS流水线ADC的低功耗设计
引用本文:王刚,何乐年,王煊. 14位100MSPS流水线ADC的低功耗设计[J]. 电路与系统学报, 2013, 18(2): 25-30
作者姓名:王刚  何乐年  王煊
作者单位:浙江大学超大规模集成电路研究所,浙江杭州,310027
摘    要:为实现14位100MSPS流水线模数转换器(ADC)的低功耗设计,提出了一种新型的运放和电容共享技术。该技术将流水线ADC的前端采样保持电路(SHC)并入第一流水线级,并在后面的流水线级中相邻两级使用运放共享技术,消除了常规的运放和电容共享技术所存在的需要额外置零状态和引入的额外开关影响运放建立时间的缺点。芯片采用TSMC 0.18μm互补型金属氧化物半导体(CMOS)混合信号工艺,仿真结果表明,在100MSPS采样率和10MHz输入信号频率下,ADC可达到77.6dB的信号噪声失调比(SNDR),87.3dB的无杂散动态范围(SFDR),±0.4LSB的微分非线性(DNL),±1LSB的积分非线性(INL),0.56pJ/conv的品质因数(FOM),在3.3V供电情况下功耗为350mW。

关 键 词:运放共享  运放和电容共享  低功耗

Low power design for 14-bit 100MSPS pipelined ADC
WANG Gang , HE Le-nian , WANG Xuan. Low power design for 14-bit 100MSPS pipelined ADC[J]. Journal of Circuits and Systems, 2013, 18(2): 25-30
Authors:WANG Gang    HE Le-nian    WANG Xuan
Affiliation:(Institute of VLSI Design,Zhejiang University,Hangzhou 310027,China)
Abstract:
Keywords:opamp sharing  opamp and capacitor sharing  low power
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