| SOC系统中高效的卷积解交织实现结构 |
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| 引用本文： | 黄戈,何大治,王白羽,梁伟强,管云峰. SOC系统中高效的卷积解交织实现结构[J]. 电视技术, 2015, 39(9): 104-107 |
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| 作者姓名： | 黄戈 何大治 王白羽 梁伟强 管云峰 |
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| 作者单位： | 1. 数字电视国家工程研究中心,上海,200125
2. 上海交通大学,上海,200240 |
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| 基金项目： | 国家自然科学基金;国家高技术研究发展计划 |
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| 摘 要： | 目前ASIC芯片高度集成,针对解调芯片在SOC系统中的集成,设计了一种高效的卷积解交织实现结构,对地址产生及整形单元做了详细阐述,并以DTMB解调模块为例,描述实现过程及实现成果,该设计通过FPGA及ASIC的充分验证,结果证明,此方案设计具有高度的可靠性和稳定性,在SOC系统中极大提高了卷积解交织对总线的访问效率,极大降低了DDR的占用带宽.
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| 关 键 词： | SOC 卷积解交织 ASIC |
| 收稿时间： | 2014-09-02 |
| 修稿时间： | 2014-11-24 |
Efficient Convolutional Deinterleaver in SOC |
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| Huang Ge,Hedazhi,Wangbaiyu,Liangweiqiang and Guanyunfeng. Efficient Convolutional Deinterleaver in SOC[J]. Ideo Engineering, 2015, 39(9): 104-107 |
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| Authors: | Huang Ge Hedazhi Wangbaiyu Liangweiqiang Guanyunfeng |
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| Affiliation: | Shanghai High Definition Digital Technology Industrial Co.,Ltd |
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| Abstract: | |
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| Keywords: | SOC convolutional deinterleaver ASIC |
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