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| 一种面向多核处理器的通用可调试性架构 | |
| 引用本文： | 杨旭,刘江,钱诚,苏孟豪,吴瑞阳,陈云霁,胡伟武. 一种面向多核处理器的通用可调试性架构[J]. 计算机辅助设计与图形学学报, 2011, 23(10) |
| 作者姓名： | 杨旭 刘江 钱诚 苏孟豪 吴瑞阳 陈云霁 胡伟武 |
| 作者单位： | 1. 中国科学院计算技术研究所计算机系统结构重点实验室 北京100190;中国科学院研究生院 北京 100049 2. 北京航天自动控制研究所四室 北京100854 3. 中国科学院计算技术研究所计算机系统结构重点实验室 北京100190 |
| 基金项目： | 国家科技重大专项(2009ZX01028-002-003,2009ZX01029-001-003,2010ZX01036-001-002); 国家自然科学基金(60921002,61050002,61003064,60736012) |
| 摘 要： | 硅后调试对于当代集成电路设计变得日益重要,用于辅助硅后调试的可调式性设计(DFD)应运而生.由于多核处理器往往包含多种不同类型的部件,每个部件都有各自的调试功能需求,极大地提高了可调式性设计的复杂度.针对上述问题,提出一种面向片上多核处理器的通用可调试性架构.该架构使用简单的监测器来监测和控制处理器中用于互连的片上网络,通过专门的调试总线将各个监测器与调试总控模块连接在一起,并使用EJTAG通用调试接口与外部调试主机传递信息.与传统的可调试性架构相比,该架构无需片上RAM,硬件代价低,具有模块化的特性.此外,文中提出的架构采用了工业界通用的EJTAG调试接口,因此通用性较高,已经被应用于龙芯-3B多核处理器中.实验结果显示,该架构可以在高频高数据带宽的环境下工作. |
| 关 键 词： | 多核 片上网络 可调试性设计 硅后调试 |
A General DFD Infrastructure for Chip Multiprocessor |
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| Yang Xu,Liu Jiang,Qian Cheng,Su Menghao,Wu Ruiyang,Chen Yunji,Hu Weiwu. A General DFD Infrastructure for Chip Multiprocessor[J]. Journal of Computer-Aided Design & Computer Graphics, 2011, 23(10) | |
| Authors: | Yang Xu Liu Jiang Qian Cheng Su Menghao Wu Ruiyang Chen Yunji Hu Weiwu |
| Affiliation: | Yang Xu1,2),Liu Jiang3),Qian Cheng1),Su Menghao1),Wu Ruiyang1),Chen Yunji1),and Hu Weiwu1) 1)(Key Laboratory o f Computer System and Architecture,Institute o f Computing Technology,Chinese Academy o f Sciences,Beijing 100190) 2)(Graduate University o f Chinese Academy o f Sciences,Beijing 100049) 3)(The Fourth Laboratory,Beijing Aerospace Automatic Control Institute,Beijing 100854) |
| Abstract: | Post-silicon debugging is becoming more and more important in modern integrated circuit design.Hence,design for debug(DFD) is proposed to facilitate post-silicon debugging.The DFD in multi-core processors are very complicate,as there are lots of different components contained in a multi-core processor,and each of them have its own debugging requirements.In this paper,we propose a general DFD infrastructure for chip multiprocessor(CMP) that contains several simple monitors to watch and control the network on... |
| Keywords: | multi-core network on chip design for debug post-silicon debug |
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