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31.
常规的转角自适应控制方法未能与同步电机的实际运行数据精准结合,导致实际控制中精度不足,因此提出基于关联规则与PLC设计的同步电机高精度转角自适应控制方法。计算同步电机的增益效率,将结果加权处理,得到同步电机转角理想传动比的计算方法。建立关联数据库,基于关联规则优化转角控制增益系数。以适应性系数判断算法终止条件,建立自适应模型结构,得到同步电机中的转角质心偏离距离,设计转角模糊自适应算法。在对比试验中,试验组中适应性系数均值为0.48/0.92 μm,3个对照组的均值分别为0.27/0.82、0.42/0.57、0.26/0.86 μm。通过试验数据可知,基于关联规则与PLC的同步电机高精度转角自适应控制方法比常规算法更适应同步电机的实际运行,具备更高的精度控制效果。  相似文献   
32.
摩擦焊机可编程控制系统的研制   总被引:2,自引:1,他引:2  
逯燕玲  李巍 《电焊机》2003,33(9):32-34
介绍了C609型可编程序控制器对摩擦焊工艺程序的控制以及对焊机检测电路、保护电路的控制,包括摩擦焊工艺流程逻辑图、PC的硬件接口及软件编程等,该PC系统结构简单,操作及修改程序容易,可靠性强,控制功能及精度亦优于原系统。  相似文献   
33.
金相显微镜三维自动平台   总被引:2,自引:0,他引:2  
运用现代计算机信息处理技术和自动控制技术,成功地对一台国产显微镜和一台进口显微镜的载物台进行了自动化改造,实现了X、Y方向自动移动和Z方向自动聚焦。本方案改造加工工作小,成本低,不破坏原有显微镜结构,同时还保留了传统的手动调节方法,使用户更容易接受。同时,系统控制软件还中嵌了软件可编程技术,从而简化了操作过程,明显减轻了劳动强度。本系统符合我国国情,是进口设备优良的替代品。  相似文献   
34.
基于FPGA的硬圆弧插补器设计   总被引:1,自引:0,他引:1  
秦兴  周川东  王文 《机床与液压》2002,(5):104-105,36
基于PC的数控系统成为开放式数控系统发展的必然趋势,其中PC加控制板卡的结构为实际的开放式标准体系。本文采用FPGA器件实现了扩展DDA圆弧插补算法,在满足较高精度的情况下,具有较快的插补速度,而且容易与电机的运动控制部分很好的信成,制作成控制板卡,从而适应目前基于PC加控制板卡的开放式数控系统的发展趋势。  相似文献   
35.
在分析PLC优缺点的基础上,提出一种利用在线可编程逻辑控制代替PLC的新技术。此外,给出了用在线可编程器件CPLD/FPGA组成的、VHDL语言实现的工件取放设备控制电路设计和程序。  相似文献   
36.
对硝基苯胺反应釜优化控制系统是以调优工作为基础,KMM可编程调节器为核心的计算机优化控制系统。该系统采用选择控制和采样调节,并有显示、记录、报警、手/自动切换等多种功能,具有功能齐全,抗干扰能力强,操作方便,稳定可靠等特点。  相似文献   
37.
基于可编程器件的通信检测系统接口设计   总被引:2,自引:0,他引:2  
针对某型通信设备检测需求,借鉴虚拟仪器设计结构,以通用计算机和多功能检测接口组成检测系统。检测接口电路使用可编程器件提高检测接口的自动化程度,以FPGA为核心单元,通过DAC和ADC完成激励信号的生成和响应信号采集,并使用混合电路完成回波抵消实现检测接口的收发双工,解决了检测系统无法实时收发的问题。描述了检测接口的设计过程,给出了硬件设计电路和FPGA程序结构框图,详细分析了以高性能运算放大器为基础设计的差分放大电路、混合电路、信号调理电路的工作原理和实现方法,对于类似系统和电路的设计有一定的参考价值。  相似文献   
38.
针对常用的M法和T法无法满足增量式光电编码器整个测速范围内误差要求的问题,提出了对码盘信号进行角位移拟合求采样时刻即时速度的新方法,在匀加速条件下对这3种方法进行了仿真实验,比较了测速误差。实验结果表明,角位移拟合法在整个速度范围内都能获得很高的测速精度和误差一致性。最后用CPLD对该方法加以实现,给出了Verilog硬件描述语言的设计程序和3种方法的实验结果比较。基于CPLD的实现方法电路简单,运行稳定可靠,处理速度快,为角位移拟合法提供了一种非常好的实现方法。  相似文献   
39.
介绍了乙炔站电石加料装置的工艺特点,采用PLC技术,提高了电石加料装置的自动化控制水平,稳定了生产。  相似文献   
40.
马绪健  刘姝  高铭泽  董秀则 《计算机应用研究》2023,40(6):1825-1828+1844
GIFT算法作为PRESENT算法的改进版本,结构上更加简洁高效,在FPGA上运行时,性能仍然存在提升空间。对此提出了一种新的实现方案,通过将算法的40轮迭代计算优化为20轮迭,并将加解密与轮密钥生成操作并行执行。在xc6slx16 FPGA平台综合后,频率可达194 MHz,吞吐量可达1.2 Gbps,消耗时钟周期21个,结果表明,所提方法相比现有工作具有更好的性能表现和更少的时钟周期消耗,实现在FPGA上高速运行是切实可行的。  相似文献   
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