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31.
系统实现了10 mV的微弱信号的程控放大和程控高低通滤波,其中程控放大利用AD620放大器和LF351实现两级增益放大,用6个继电器控制反馈电阻实现输出增益0 dB到60 dB可调;放大信号通过低通或者高通电压控制电压源(VCVS)滤波器,滤波器的截止频率从1 kHz到20 kHz可调。系统以MEGA16为控制核心,用继电器实现硬件电路的切换从而使增益可调,并设计了一个通带为50 kHz的四阶椭圆低通滤波器,滤波器的参数通过计算和PSPICE仿真结合得到,并在测试过程中修正相关参数。该系统思路简单易于实现,且各参数的误差较小。 相似文献
32.
33.
提出一种基于FPGA的跳扩频信号发送系统设计方案,系统硬件以FPGA为核心,将基带处理和中频调制完全集成在FPGA芯片内部,采用新型的高速DDS(Direct Digital Synthesis)AD9951芯片和高速数模转换器来辅助电路完成信号的产生和发送。介绍了系统软件控制流程,以及系统设计中关键技术的研究与实现。系统软件利用QuartusⅡ8.0开发平台,使用VHDL语言设计实现。借助Matlab和Multisim 10.1高频电路仿真软件分析和优化系统。系统采用数字化的相对相移键控(DQPSK)调制,整体发送数据速率4.8 kb/s,在108~155.975 MHz范围内实现宽间隔跳频发送数据。 相似文献
34.
随着高速数据采集系统的快速发展及其复杂性提高,其关键部分高速ADC(Analog to Digital Converter,模/数转换器)对时钟质量的要求也越来越高,为此提出了一种基于内部集成2.5 GHz VCO(压控振荡器)的低相位噪声锁相环时钟芯片AD9520[1]的高质量时钟电路设计,介绍了在5 Gs/s高速数据采集系统中AD9520的具体设计应用,包括其控制寄存器的参数配置以及初始化顺序等,给出了该高速数据采集系统的原理框图,并采用Xilinx公司ISE软件中的在线逻辑分析仪(ChipScope Pro)测试了时钟性能,实测表明整体指标达到设计要求。 相似文献
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37.
38.
设计了以FPGA为核心控制芯片的虚拟电源系统。实现了虚拟电源的硬件平台和软件系统,包括控制开关模块、电压采集模块、电压输出模块、电压自调整模块、UART模块、数值转换模块等。系统利用UART与上位机实现通信,通过控制AD5662和TPS5450芯片输出设定电压,并实时地从AD7699芯片处获得实际输出电压值,通过自调整模块使电压稳定在设定值的附近。电压测试范围从2.6V到4.2V,当系统不带负载时,输出电压的纹波小于10mV,当输出电流为1A时,输出电压纹波小于20mV。 相似文献
39.
设计了一种HART协议通信接口。给出了具体的软硬件设计,采用HART专业低功耗调制解调芯片AD5700实现了HART信号的调制、解调与载波监听,利用AD5421电流环数模转换器实现了4m A-20m A电流输出及变送器的二线制传输,达到了变送器与上位机进行HART远程通信的目的。 相似文献
40.