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51.
面向下一代网络的端到端多路径传输层架构   总被引:1,自引:0,他引:1  
为了解决传统网络无法有效同时使用多家乡终端的多个接口传输数据的问题,提出了一种面向下一代网络的端到端多路径传输层架构-E2EMP.E2EMP通过自适应的根据路径特性分发数据,采用双层序列空间,实施灵活的端到端路径管理,提高了多家乡终端的传输性能.实验仿真表明,E2EMP能够有效地聚合终端多家乡的出口带宽,同时提高了数据传输的安全性和可靠性.  相似文献   
52.
沈箭 《城市建筑》2009,(11):18-19
本文以美国建筑设计行业的职业环境为背景,阐释建造体系中的项目递交体系及应用实例,分析国外建造体系的运作机制、特点及其对设计的影响,以指导我国建筑行业高速发展的现状。  相似文献   
53.
《Planning》2019,(4)
介绍了5G基站系统实现上行信令的完保解密过程,提出了信令消息乱序接收后正确处理的实现方法,并对原理进行了说明,最后通过测试验证,保证了gNB接入信令流程的完成。  相似文献   
54.
衡量大数据的数据挖掘性能有2个最重要的任务指标:一是实时性,二是准确性。流数据从数据产生到消息队列再通过数据源流入Flink进行计算,这个过程中因为网络传输速度不同,不同节点的计算性能不同等原因,流数据进入计算框架的先后顺序和数据产生的事件时间顺序会有局部乱序的现象。面对窗口作业的传统水位线机制在不确定乱序程度的流数据情况下无法同时兼顾作业结果的实时性和准确性。针对这个问题,建立了流数据微簇模型。通过局部乱序度算法,根据流数据微簇的流数据事件时间局部乱序程度计算出可以代表当前时刻流数据的乱序度。设计了水位线动态调整策略,使水位线根据流数据的乱序程度动态调整大小。最后,在Apache Flink框架中对基于事件时间窗口的水位线动态调整策略进行了实现。实验结果表明,弹性或不确定乱序流数据条件下,基于事件时间窗口的水位线动态调整策略可以有效地同时兼顾窗口作业的准确性和实时性。  相似文献   
55.
DTN中基于节点质量的自适应散发和等待路由   总被引:1,自引:1,他引:0  
针对节点活动性的差异,给出了节点质量的定义,提出了基于节点质量的自适应散发和等待路由协议。该协议通过引入节点质量的观点来动态地转发报文拷贝数,从而避免了二分散发和等待路由协议在转发报文拷贝数时的盲目性。仿真结果显示,该协议更能够适应自组织状况下动态的网络拓扑,在改善报文递交率和延迟的同时能显著提高报文的递交效用、减小网络开销率。  相似文献   
56.
介绍一种优化的快速模板匹配算法,可实现目标实时提取、识别和跟踪,并成功应用于红外热成像跟踪技术的研究,解决了复杂背景条件下目标跟踪稳定度差的技术难点。该算法用Vi-sualC++编写,可方便地移植到其它操作平台或嵌入式系统。  相似文献   
57.
一种等距曲面求交的新算法   总被引:1,自引:3,他引:1  
参照了等值线的方法,采用先确定交线拓扑结构,然后进行跟踪的方法,来进行参数曲面的等距曲面鲁棒、精确和高效的求交计算,采用该方法,可以直接得到交线在两张原曲面参数域上的轨迹,而不需要进行等距曲面的逼近或从三维交线反求参数域上的轨迹,并且交线都以定义在[0,1]上的参数曲线的形式给出,数值实验证明,算法可以有效地解决等距曲面求交的子环遗漏、分支跳跃、乱序跟踪等问题,精确鲁棒地计算出交线。  相似文献   
58.
基于硬件的乱序报文重组算法   总被引:1,自引:1,他引:0       下载免费PDF全文
在硬件实现TCP时,TCP协议对接收报文的乱序管理使硬件实现复杂度大为增加。针对该问题,提出一种利于硬件执行的算法,将数据直接基于序列号进行放置,同时进行序列号映射比较。实验结果表明,该算法具有易于实现、执行效率高的优点,使10G接口的TCP数据传输率达到4.64 Gb/s。  相似文献   
59.
发射队列是超标量处理器的乱序控制部件,也是处理器中的关键部件,对整个处理器的性能起着决定性的作用.提出了一种能够有效提高乱序超标量处理器性能的双端口发射队列结构.该队列能够根据指令之间的相关性,估算指令的发射时机,将指令分配到不同的队列中.对比了2种不同的发射策略对性能的影响,输入端标记执行流水线的策略能够获得较高的IPC性能,最大能提高10.68%.同时对比了采用相同发射策略时,发射队列项数对性能的影响,相比于24项发射队列,32项发射队列能够平均提升2% 的IPC性能,最大可以提升8.59%.  相似文献   
60.
随着无线连接、大数据、人工智能技术的快速发展,嵌入式领域的设备开始具备更多的感知能力和更灵活的网络连接功能。从应用的发展趋势来看,这些设备不仅需要超低功耗,而且需要具备更强大的数据采集和处理能力。基于性能和功耗的折中要求,本文提出了一种低开销、高性能、顺序取指、乱序执行的RISC-V处理器架构。首先详细介绍了各级流水线之间的结构和内在逻辑关系,最后对处理器的性能做了跑分测试。  相似文献   
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