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61.
62.
详细阐述了复合相变换热器的技术原理,并结合现场实际案例对使用相变换热技术前后的加热炉排烟温度、换热器酸露腐蚀程度以及节能情况进行了综合分析和对比,实现了复合相变换热技术在加热炉上的成功应用.  相似文献   
63.
苯并咪唑类化合物缓蚀性能的量子化学研究   总被引:1,自引:0,他引:1  
采用量子化学密度泛函理论(DFT)的B3LYP法,基于6-31G(d)和6-311+G(d,P)基纰水平,研究5种苯并咪唑类化合物:苯并咪唑(BIM)、2-丙基苯并咪唑(2-PBIM)、2-戊基苯并眯唑(2-ABIM)、2-己基苯并咪唑(2-HBIM)和2-对氯苄基苯并咪唑(2-CIBBIM)的缓蚀性能与分子结构的关系,讨论量子化学计算结果与缓蚀性能的关系.结果表明,缓蚀剂的缓蚀效率与分子的最稳定质子化形式的最高占据轨道的能量EHOMO、质子化分子的硬度(η)及咪畔环上氮原子的净电荷相关性较好.通过缓蚀剂分子质子化能(PA)及咪唑环上N原子净电荷的分析,可以认为苯并咪唑类缓蚀剂在酸性环境中足以其吡啶N发生质子化形式存在,且通过咪唑环上大π键与金属之间发生作用.  相似文献   
64.
为了满足深紫外光刻物镜对薄膜的要求,得到低损耗、高稳定性、长寿命的深紫外薄膜,需要选用适当的镀膜工艺方法。分别选取了离子束溅射法、热舟蒸发法和电子束蒸发法优化后的最佳工艺参量,在融石英基底上使用3种方法镀制了单层LaF3薄膜。首先,利用光度法得出3种方法镀制LaF3薄膜在185nm~800nm范围内的折射率n和消光系数k。然后,采用原子力显微镜对薄膜表面粗糙度进行了测量。最后,薄膜的微结构使用X射线衍射仪进行了分析。结果表明,离子束溅射镀制的LaF3薄膜折射率最高、表面粗糙度最低,但吸收较大;电子束蒸发法虽然吸收最小,但是折射率偏低且表面粗糙度较高;热舟蒸发法镀制的LaF3薄膜无论折射率、消光系数还是表面粗糙度都处于3种方法中间位置。综合各项指标,热舟蒸发法最适合于沉积深紫外LaF3薄膜。  相似文献   
65.
从邯钢CSP热轧生产线轧辊的使用情况出发,介绍了邯钢CSP生产线的工艺流程、轧辊(工作辊)的主要参数。对轧辊在使用过程中出现的问题进行了分析,并提出了有效的应对措施。  相似文献   
66.
晶振膜厚监控技术中Tooling Factor的精确标定   总被引:1,自引:0,他引:1  
张立超 《光机电信息》2010,27(11):56-60
晶振监控法是一种实现非规整膜系监控的重要手段。在晶振监控中,晶振片与镀膜基片上沉积薄膜厚度的比值,即Tooling Factor是相对固定的。采用晶振监控法实现薄膜厚度的精确控制必须对Tooling Factor进行精确标定。本文提出了精确标定Tooling Factor的方法,并对这种方法进行了实验验证。结果表明,该方法能够将膜厚控制误差从~20%降低到6%的水平,从而使多层膜的反射率曲线更加接近设计结果,实现多层膜膜厚的精确控制。  相似文献   
67.
采用多种群遗传算法的全景成像系统非球面设计   总被引:4,自引:1,他引:3  
提出了一种基于多种群遗传算法(MPGA)的折反射全景成像系统非球面元件的设计方法.结合广义科丁顿公式及几何光学原理,推导出非球面两镜系统像散表达式.在此基础上,利用MPGA,以像散作为非球面两镜系统像差评价参数,求解出满足消像散及指定透视投影关系的非球面面形方程.给出MPGA求解非球面面形的实现过程,并用遗传算法最小二乘混合优化算法得到了便于实现光线追迹和像差计算的非球面多项式.研制了一个焦距为-1.2 mm,F数为1.5 ,视场为360°×(35~90°)的折反射全景成像系统,给出了实验图像,获得了较好的成像质量.  相似文献   
68.
介绍了邯钢采用铌铝微合金化和控制轧制工艺研制桥梁用结构钢A709—50T-2的情况,A709—50T-2钢的各项性能指标完全满足用户的使用要求。  相似文献   
69.
X射线衍射仪样品装调误差分析与校正   总被引:1,自引:0,他引:1  
使用X射线衍射仪分析样品,测试角度误差的大小影响着分析结果的准确性,而样品装调误差会导致测试角度误差.本文系统分析了样品装调对测试角度误差的影响.结论是,转动误差和偏心误差对测量误差影响较大,一般需要校正;俯仰误差对测量结果影响较小,一般不用校正.实验表明,通过校正样品装调后的转动误差和偏心误差,可以将测量角度随机性误差控制在0.006°(2θ)以内,并将周期厚度为17nm左右的[Mo/Si]多层膜的测试周期厚度精确到0.1nm,为极紫外区高精度膜厚控制提供了保证.  相似文献   
70.
多FPGA设计的时钟同步   总被引:1,自引:0,他引:1       下载免费PDF全文
在多FPGA设计中,时钟信号的传输延时造成了FPGA间的大时钟偏差,进而制约系统性能。为减少时钟偏差,该文提出一种多数字延迟锁相环(DLL)电路。该电路将时钟的传输电路放入DLL的反馈环路。利用DLL的延迟锁定特性,对FPGA间的时钟传输延时进行补偿,减少FPGA间的时钟偏差,解决多FPGA的时钟同步问题。  相似文献   
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