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IEEE 1588协议为分布式系统的时钟精确同步提供了一种有效可行的解决办法。为了达到低成本高精度的目的,充分利用Linux操作系统特性,在不依靠专用硬件的支持下对时钟本身的计时、时间戳标记、误差抑制提出详细分析和设计;通过不同网络条件下的同步实验,证明函数补偿、负载均衡等对于性能提升和误差抑制都有很大的帮助。结果表明,软件实现方案完全可以满足大部分的时钟同步需求。 相似文献
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文章首先介绍IEEE1588时钟同步基本原理,然后搭建了在ARM11微处理器S3C6410A下采用WinCE6.0系统的测试平台。在该测试平台下,给出了时钟同步的纯软件和硬件辅助设计.硬件辅助设计中采用了半导体芯片DP83640。经过测试,纯软件设计的时钟同步精度可达次毫秒级,而硬件辅助设计的时钟同步精度可达到次微秒级。 相似文献
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《电子技术与软件工程》2019,(12)
本文简要阐述了IEEE1588时钟同步系统其工作原理,分析了同步系统定时性能受什么因素的影响,提出了在随机大网络延迟抖动情况下,采用PID方法对其进行相位调整的。结果表明,让时钟定时精度在定时系统精度指标范围内稳定可以使用该方法。 相似文献
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文章首先介绍IEEE1588时钟同步基本原理,然后搭建了在ARM11微处理器S3C6410A下采用WinCE6.0系统的测试平台。在该测试平台下,给出了时钟同步的纯软件和硬件辅助设计,硬件辅助设计中采用了半导体芯片DP83640。经过测试,纯软件设计的时钟同步精度可达次毫秒级,而硬件辅助设计的时钟同步精度可达到次微秒级。 相似文献
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本文简要分析了IEEE1588协议的时间同步原理,从工程实践的角度提出了一种基于现场可编程逻辑门阵列(FPGA)的IEEE1588时间同步技术的实现方法,给出了实现方案和框图。重点分析了采用FPGA实现硬件时间戳的方法,并给出相应的仿真结果。 相似文献
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为实现分布式系统高精度同步数据采集及实时控制,提出一种基于IEEE 1588协议的分布式系统时钟同步方法。通过分析影响同步精度的因素,采用FPGA设计时间戳生成器,并且采用晶振频率补偿时钟解决时间戳的精确获取和从时钟相对主时钟的频率纠偏等问题。 相似文献
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采用美国国家半导体公司推出的专用集成有IEEE1588精准时钟协议硬件支持功能的以太网收发芯片DP83640,通过在物理层标记PTP时钟同步报文发送和到达的时刻,与TI公司的内置以太网媒体接入控制器(MAC)功能的TMS320DM642芯片连接实现高精度的时钟同步功能。 相似文献
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帧同步算法通过检测帧头信息,使接收机从接收数据流中提取帧起始时刻和初始频偏,以引导解调环路恢复出有效数据。本文首先简要介绍了基于相关的经典帧同步算法原理,然后分析了信道环境对相关性能的影响,最后详细描述了一种经过改进的精确帧同步算法及其FPGA实现结果。该算法综合采用了分段本地相关、分段延迟相关和动态检测门限,有效解决了在大频偏和强噪声环境下的捕获虚(漏)警问题,并通过过采样和平滑提高了帧起始时刻与初始频偏的捕获精度,使解调环路锁定更快。测试表明,该算法复杂度适中,在低信噪比、高频偏环境下也具有优异性能,适合应用于卫星通信接收机。 相似文献
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针对航空信道的复杂性和对信号干扰较大的问题,利用L-DACS1反向链路随机接入帧结构的特点,研究了粗定时同步与精定时同步的算法,并基于现场可编程门阵列(FPGA)在Apex-CPCI-5610通信开发板上实现了这种算法,应用于实际的项目上.测试结果表明,该方法能够精确得到定时同步的位置且系统工作稳定,能够满足L-DACS1系统的设计要求. 相似文献
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采用FPGA进行的数字电路设计具有更大的灵活性和通用性,已成为目前数字电路设计的主流方法之一.本文给出一种基于FPGA的数字钟设计方案.该方案采用VHDL设计底层模块,采用电路原理图设计顶层系统.整个系统在QuartusⅡ开发平台上完成设计、编译和仿真,并在FPGA硬件实验箱上进行测试.测试结果表明该设计方案切实可行. 相似文献