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测速仪是构建现代智能交通系统的重要组成部分。测速雷达由于频域采样时的频谱泄露,影响和限制了雷达对速度的最小分辨能力。运用相位差法对测速雷达回波信号的频谱进行校正,可以显著提高测速精度。给出了相位差法在DSP器件TMS320F28335上的实现方法,可使雷达响应时间小于10ms,测速精度达到0.1 km/h。 相似文献
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作为JEDEC最新的AD/DA采样数据传输协议,JESD204B协议新增了对多通道串行传输的同步支持。为了确保多通道同步传输的准确性,发送端同步电路采用Verilog HDL设计并实现了协议规定的码群同步,初始通道对齐与的同步字节替换等功能。Modelsim仿真结果验证了发送端同步电路符合协议要求,Design Complier(0.18 μm工艺库)综合结果表明电路在数据传输阶段的处理频率达到255.03MHz,可应用于JESD204B高速串行接口电路设计中。 相似文献
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行业新标准JESD204B支持高达12.5 Gbit/s串行传输速率,是解决数据转换器与逻辑器件之间高速数据传输问题的主流接口。采用四字节并行处理方案实现了JESD204B协议接收端数据链路层电路,完成协议功能的同时将电路工作时钟频率由1.25 GHz降低到312.5 MHz,使其能在CMOS工艺下使用标准数字电路设计流程实现。将Verilog HDL实现的电路与XILINX JESD204B 6.1v版本的发送端IP核进行对接,验证了该方案的可行性。在Design Compiler平台上,采用65 nm LP CMOS工艺数字标准单元库,对设计方案进行了综合评估。实验结果表明,该方案在工作频率和功能方面均能满足JESD204B协议规范。 相似文献