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991.
提出了一种优化的SRAM,它的功耗较低而且能够自我修复.为了提高每个晶圆上的SRAM成品率,给SRAM增加冗余逻辑和E-FUSE box从而构成SR SRAM.为了降低功耗,将电源开启/关闭状态及隔离逻辑引入SR SRAM从而构成LPSR SRAM.将优化的LPSR SRAM64K×32应用到SoC中,并对LPSR SRAM64K×32的测试方法进行了讨论.该SoC经90nm CMOS工艺成功流片,芯片面积为5.6mm×5.6mm,功耗为1997mW.测试结果表明:LPSR SRAM64K×32功耗降低了17.301%,每个晶圆上的LPSRSRAM64K×32成晶率提高了13.255%. 相似文献
992.
研究了新型的FDP FPGA电路结构及其设计实现.新颖的基于3输入查找表的可编程单元结构,与传统的基于4输入查找表相比,可以提高约11%的逻辑利用率;独特的层次化的分段可编程互联结构以及高效的开关盒设计,使得不同的互联资源可以快速直接相连,大大提高了可编程布线资源效率.FDP芯片包括1600个可编程逻辑单元、160个可用IO、内嵌16k双开块RAM,采用SMIC 0.18μm CMOS工艺全定制方法设计并流片,其裸芯片面积为6.104mm×6.620mm.最终芯片软硬件测试结果表明:芯片各种可编程资源可以高效地配合其软件正确实现用户电路功能. 相似文献
993.
提出了一种新的嵌入在FPGA中可重构的流水线乘法器设计.该设计采用了改进的波茨编码算法,可以实现18×18有符号乘法或17×17无符号乘法.还提出了一种新的电路优化方法来减少部分积的数目,并且提出了一种新的乘法器版图布局,以便适应tilebased FPGA芯片设计所加的约束.该乘法器可以配置成同步或异步模式,也町以配置成带流水线的模式以满足高频操作.该设计很容易扩展成不同的输入和输出位宽.同时提出了一种新的超前进位加法器电路来产生最后的结果.采用了传输门逻辑来实现整个乘法器.乘法器采用了中芯国际0.13μm CMOS工艺来实现,完成18×18的乘法操作需要4.1ns.全部使用2级的流水线时,时钟周期可以达到2.5ns.这比商用乘法器快29.1%,比其他乘法器快17.5%.与传统的基于查找表的乘法器相比,该乘法器的面积为传统乘法器面积的1/32. 相似文献
994.
随着技术进步,手机的视频播放功能也越来越强,IPhone的3.5英寸、480K分辨率的多重触摸屏,为用户提供了较完美的视觉体验和交互能力.手机移动视频已经为更多的用户使用。ABI Research的研究报告显示.2008年,中国移动视频用户将超过3200万。 相似文献
995.
基于正余弦编码器反馈处理的FPGA在伺服驱动中的应用 总被引:1,自引:0,他引:1
伺服驱动用于自动化系统、机器人、以及专用机器与机床的驱动系统等众多领域。这些要领域均对动力学、速度的稳定性和精度具有一定的要求,而满足这些要求时需要增加控制环的带宽。本文描述了一些基于FPGA的编码器方案以连接伺服驱动。由于数字滤波器在FPGA中的使用,位置信号的质量显著提高。用于伺服驱动后,这种较好的信噪比的信号可实现相对平滑(低噪)的电机电流,并可以提高控制环的增益。 相似文献
996.
首先简述了协同作战能力(CEC)系统的概念、功能和组成.在此基础上,以美国典型的导弹防御系统--航母战斗群反导系统为背景,构建了以协同作战能力系统为核心的分布式交互仿真系统,分析、研究了协同作战能力系统的仿真模型;同时,文章提出的仿真模型已应用于航母战斗群反导系统仿真系统中,仿真结果充分验证了模型和方法的有效性,为深入研究协同作战能力系统奠定了技术基础. 相似文献
997.
998.
999.
1000.