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32位可重构多功能乘法器的设计与实现 总被引:1,自引:1,他引:0
为了提高计算机硬件的利用率,及改善计算性能,提出了一种32位可重构多功能乘法器的实现方法,并能完成8位有符号、无符号,16位有符号、无符号,32位有符号、无符号的乘法,共6种乘法计算功能,并用verilog实现了设计,进行了仿真,得到了正确的结果. 相似文献
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公司现有的生产线上的油位传感器性能测试设备采用静态测试方法,该方法无法对油位传感器进行全量程的动态性能测试.为更加精确地进行油位传感器性能测试,提高品质并缩短测试时间,需要在较短的时间内高效、快捷、独立自主的开发出全新的油位传感器动态性能测试设备. 相似文献
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对一种流水线型模数转换器(ADC)的时序电路进行了改进研究。改进时序延长了余量增益单元MDAC部分加减保持相位的时长,可以在不增加功耗与面积的情况下,将一种10位流水线型ADC在20 MS/s采样率下的有效位(ENOB)从9.3位提高到9.8位,量化精度提高了5%;将该ADC有效位不低于9.3位的最高采样率从21 MS/s提高到29 MS/s,转换速度提高了35%。ADC的采样频率越高,改进时序带来的效果越显著。该项技术特别适用于高速高精度流水线型ADC,也为其他结构ADC的高速高精度设计提供思路。 相似文献
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现今的嵌入式工业及汽车系统中,有许多是基于8位或1 6位微控制器架构来设计的。随着新的低功耗32位架构的面市,这些应用有可能获得更高的性能、准确度和功效。此外,处理能力的提高也有助于实现新产品的差异性功能,包括先进的控制算法,GUI显示器、语音控制, 相似文献
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微处理机以集成技术为基础,自1971年4位CPU—4004问世以来,16年间随着大规模和超大规模集成电路的设计和制造工艺的惊人发展,使微处理机从8位发展到16位、32位.微处理机的性能不断提高,现已研制成具有高精密体系结构的微处理机.目前,32位CPU逐渐成为通用微处理 相似文献
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ADI最近宣布推出据称业界速度最决的16位ADC(模数转换器)——250MSPS(兆每秒采样)AD9467。与其它16位数据转换器相比,这款16位、250MSPSADC可在能耗降低35%的隋况下将采样率提高25%,其信号处理性能达到新的高度,适合测试和测量仪器、 相似文献
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描述了一种新型的高性能高能效SIMD乘法阵列的结构.该乘法阵列支持同时执行1个64位乘法,4个32位乘法或16个16位有符号/无符号乘法.通过修改乘法算法实现结构,提高了乘加单元的面积复用度,在较小的面积和性能开销下实现了上述功能.并引入了"溢出补偿技术"解决了复数矩阵乘法运算的判溢出问题.通过牺牲非关键路径上短位宽乘法性能,提高关键路径上高位宽乘法性能.所述结构与文献[1]中乘法簇结构相比,64位乘法延时减少3.65%,面积降低3.92%,功耗提高5.71%. 相似文献
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针对静态随机存取存储器(SRAM)型现场可编程门阵列(FPGA)位流码配置问题,提出一种自动配置互连资源的方法。该方法从描述FPGA结构的行为级Verilog文件中,采用基于端口映射的记忆FPGA配置模型搜索(MCMS)算法自动提取互连资源的配置位模型,然后结合布线结果生成布线路径上互连资源的位流码。实验结果表明,对于包含30 Mb配置位的3 000万门SRAM型同质FPGA,采用人工方法提取互连资源配置位模型需要6天时间,而采用端口映射MCMS算法仅需要29分钟,效率提高了298倍;对于同等规模的异质FPGA,采用人工方法需要7天时间,而采用端口映射MCMS算法仅需26分钟,效率提高了394倍。该算法作为一种通用的互连资源配置位模型提取方法,可以应用于不同的FPGA芯片。在缩短位流码配置时间的同时,提高位流码配置的准确性。 相似文献
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提出的基于匹配滤波的位同步算法有效利用了这种信号结构,可以显著提高位同步的灵敏度.仿真结果表明,以NH(20)次码信号结构的信号为例,采用2s的位同步时间,在错误位同步概率为1e-3的情况下,位同步灵敏度可以达到12 dB-Hz. 相似文献
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一、引言近二十年来,以集成电路(IC)和微计算机为中心的微电子技术发展十分迅速。集成电路已从小规模集成电路发展到了超大规模集成电路(VLSI)。目前已能大量生产第一代VLSI(16K位静态RAM~*、64K位动态RAM及16位微处理器);科研水平是第二代VLSI(64K位静态RAM、256K位动态RAM及32位微处理器);今年将发表256K位静态RAM。在整个七十年代中,电路的集成度平均每两年提高4倍,每块电路 相似文献
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分析了加工件位姿与测量及加工的关系,提出了可调性一体化工作台的概念,给出了通过调整工作台位姿(也就是相应加工件位姿)来改善测量及加工的方法。即在建立测量及加工最佳位姿标准及坐标转换体系的基础上,通过调整加工件位姿,使加工件位姿达到或接近最佳状态,从而提高测量及加工的灵活性,改善测量及加工的效果。这对提高激光加工的效率和实现柔性加工都具有重要意义。 相似文献
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有限长单位冲击响应滤波器(FIR)是合成孔径雷达(SAR)系统的重要组成部分。为综合考虑资源与性能对系统的影响,基于现场可编程门阵列(FPGA)设计实现了位宽、阶数可配置的SAR雷达信号处理FIR系统,首次完成了合理范围内的只读存储器(ROM)地址位宽和所有输入并行度设置下的分布式算法(DA)结构对比实验,并对不同结构实现下的系统性能资源比进行了全面分析和比较,得到了最优化高并行度DA结构。实验结果表明在ROM地址位宽为4或5时性能资源比最好;性能资源比随输入并行度的提高而提高,当输入并行度为输入数据位宽时,性能资源比提高24%至117%。对比传统的全串行结构、全并行结构和DA结构,经ROM地址位宽和输入并行度优化后的DA结构的性能资源比分别提高了3 110%,76%和86%。 相似文献