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相似文献
 共查询到10条相似文献,搜索用时 109 毫秒
1.
车德亮  赵宁 《微机发展》2006,16(1):23-26
提高功能部件的并行性是开发高性能微处理器的基本途径。在RISC处理器中设计独立的地址产生器可实现算术运算与地址运算并行处理,从而提高RISC处理器的性能。文中根据现今RISC处理器中常用的寻址方式,提出了一种RISC地址产生器生成算法并进行了实例化。实例化结果可作为IP核应用到RISC处理器的设计中。  相似文献   

2.
DSP处理器面向数字信号处理领域,具有高度的实时性要求。论文设计了一种能够满足DSP处理器特殊寻址方式的地址产生单元,同时支持并行指令的执行,实现了算术运算与地址运算的并行处理,有效地提高了数字信号的处理速度。  相似文献   

3.
在微处理器运算速率的竞争较量中,由高级微器件(AMD)公司设计的Am29000无疑占了上风。Am29000流线型指令处理器采用了增强型减少指令系统(RISC)设计,被认为是目前世界上运算速率最高的32位微处理器。加州的Sunnyvale公司将这种新型微处理器  相似文献   

4.
张健浪 《微型计算机》2007,(11S):153-155
处理器的发展已经到了一个新关口,英特尔在抛弃高频率路线之后,以多核和内部架构的改进作为主要方向:AMD则开始谋求协处理加速机制,SUN公司在UltraSparc T1/T2处理器中采用专用化设计,IBM和Cell则以前卫的分式计算理念打造超级计算系统,无论是传统的x86体系还是RISC体系,都在积极谋求更卓越的运算性能,  相似文献   

5.
新技术追踪     
由于仅靠精减指令集运算(RISC)处理器的软件路由器已不能满足对带宽及其他先进功能的要求,许多路由器设计人员开始考虑用全定制专用集成电路(ASIC)取代RISC处理器。 ASIC是针对特殊用途设计的芯片,具有密度高、速度快,成本低等多项优点。ASIC技术发展很快,许多过去由软件完成的功能可能移给ASIC。最新的0.25微米ASIC技术可在单一150MHz芯片上  相似文献   

6.
在国产申威高性能多核服务器系统中,基础编译系统对应用程序中访存操作进行代码生成时,没有考虑国产处理器指令特征,导致编译器生成的访存地址计算代码效率较低,影响国产高性能处理器的性能。为充分发挥国产处理器高性能计算能力,提出一种加速访存地址计算的编译优化方法。加速访存地址计算编译优化基于处理器支持带扩展因子的运算指令,在编译器后端内存地址表达式合法性检查中,添加针对乘加模式的地址计算表达式合法性检查算法,自动识别地址表达式中存在的乘加运算并进行合法性检验,对符合条件的地址表达式在代码生成阶段匹配生成带扩展因子的运算指令来快速计算访存地址,从而加快访存指令的发射与执行以及应用程序中的访存地址生成,提升访存效率。使用行业标准性能测试集SPEC CPU2006对优化效果进行评测,结果表明,相比优化前SPECspeed Integer与SPECspeed Float Point两个子集,该优化方法平均性能分别提高了2.53%与1.50%。  相似文献   

7.
DSP体系结构发展的新趋势   总被引:3,自引:0,他引:3  
CISC→RISC设计思想对DSP体系结构设计中数据和指令级并行性开发产生了深刻影响,融合RISC和SIMD技术的单核处理器已经成为DSP体系结构设计的新趋势。  相似文献   

8.
李辉楷  韩军  翁新钎  贺中柱  曾晓洋 《计算机工程》2012,38(23):240-242,246
针对AES与SHA-3候选算法中Gr?stl软件运算速度慢的问题,提出一种通过精简指令集计算机(RISC)协处理器来加速算法运算的设计方案。该协处理器复用片上高速缓存充当查找表来加速运算,并在RISC处理器的基本指令集架构中增加特殊指令。实验结果表明,与传统基于并行查找表的方案相比,该方案能够以较小的硬件代价加速AES与Gr?stl运算。  相似文献   

9.
木星 《个人电脑》2005,11(5):36-38
这款产品提供了4个10/100M自适应端口,其宽带连接可以支持动态P,PPPoE等多种连接方式,由于采用了200MHz频率的RISC处理器以及硬件NAT/NAPT设计.DI-604 可以为用户提供更好的数据吞吐处理能力,很多路由器都是通过处理器来计算NAT/NAPT地址转换,而DI-604 在工作时直接将接收封包经由NAT/NAPT硬件转换线路从以太网缓存区传出,完全免除了CPU软件处理造成的延时。  相似文献   

10.
专用指令集处理器(ASIP)结合了ASIC协处理器的高效性与通用处理器的灵活性,在信息安全领域具有广泛的应用前景.本文针对RSA/ECC密码算法,提出了一种专用指令集安全处理器的设计与VLSI实现方案.本文的ASIP基于32位RISC架构,通过采用专用的指令集和特殊的运算单元,以较小的软硬件代价实现了密码算法的高效运算.本设计采用TSMC0.25μm标准CMOS工艺综合,核心电路等效门为28K,最高时钟频率可达到150MHz,完成一次1024位RSA算法仅需200毫秒.  相似文献   

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